QSFP28 LR4 광수신기가 통합하는 100G는 원 모듈 위에 경로를 받습니다. 광 데이터의 수신기 4 레인
흐름은 광학적으로 통합된 광 멀티플렉서에 의해 역다중화처리됩니다. 각각 데이터 수증기는 핀 광검출기에 의해 복구됩니다고
출력 드라이버에 레티메드와 통과되는 트랜스임피던스 증폭기. 이 모듈은 낮은 핫 블러그 가능한 전기 인터페이스를 특징으로 합니다
소비 전력과 2번 와이어 직렬 접속.
기록 :
1 : 국민 총수요는 신호을 나타내는 상징이고 모듈을 위해 공통인 공급 (전력) 입니다. 모두는 모듈 이내에 공통이고 모든 모듈 내압이 있습니다
달리 언급되지 않으면 이 잠재성에 참조 사항이 달립니다. 직접적으로 호스트 보드 신호 공통 접지 평면에 이것들을 연결하세요.
2 : 프크크 Rx, Vcc1과 프크크 Tx는 동시에 적용될 것입니다. 프크크 Rx Vcc1과 프크크 Tx는 내부로 누구에서 모듈 내에 연결될 수 있습니다
조합. 커넥터 핀은 각각 1000 마의 최대 전류를 위해 평가됩니다. 추천된 호스트 보드 전력 공급 필터링은 보여집니다
아래 .
3 : 모듈셀은 입력 핀입니다. 호스트에 의해 낮게 잡힐 때, 사령선은 2 와이어 직렬 통신 지휘에 응답합니다. 모듈셀은 인정합니다
한 개의 2 와이어 인터페이스 버스 위의 다중 모듈의 사용. 모듈셀이 높은 것일 때, 모듈은 누구를 응답하거나 확인하지 않을 것입니다
호스트로부터의 2 유선 인터페이스 통신. 모듈셀 신호 입력 노드는 모듈에서 하이상태에 편견을 가질 것입니다. 회피하기 위해
갈등, 호스트 시스템이 어떠한 모듈도 선택해제되는 후에 모듈셀 인가 해제 시간 이내에 2 유선 인터페이스 통신을 시도하지 않을 것입니다.
유사하게, 호스트는 최근에 선택된 모듈과 통신하기 전에 모듈셀이 시간을 주장하는 색택 고정기를 적어도 기다릴 것입니다. 더
다른 모듈의 주장과 디어서팅 기간은 위에서 말한 타이밍 요구사항이 충족되는 한 중첩될 수 있습니다.
4 : 리셋들 핀은 모듈에서 프크크에 끌려올 것입니다. 최소 펄스 길이 (t_Reset_init)보다 더 오랫동안의 리셋들 핀 위의 낮은 수준
모든 사용자 모듈 설정을 그들의 디폴트 상태로 되돌리면서, 완전한 모듈 리셋을 착수합니다. 모듈 리셋은 상승 위의 타임즈 지 (t_init) 시작을 주장합니다
리셋들 핀 위의 낮은 수준이 공개되는 후에 비스듬히 나아가세요. 리셋의 실행 동안 (t_init) 호스트는 모듈까지 모든 상태 비트를 무시할 것입니다
리셋 인터럽트의 완료를 보여줍니다. 모듈은 data_not_ready 비트와 IntL 신호가 낮다고 주장하는 것에 의한 이것이 부정한 것을 나타냅니다.
모듈이 리셋을 요구하지 않고 리셋 인터럽트의 이 완료를 부쳐야 하는 (핫 삽입을 포함하여) 전원 켬 위의 그것을 주목하세요.
5 : SCL과 SDA 외에 저속도 신호화는 프크크에 저전압 TTL (LVTTL) 작동을 기반으로 합니다. 프크크는 일반적 공급을 언급합니다
프크트스, 프크크스, vcc_host 또는 Vcc1의 전압.
호스트들은 각각의 2 유선 인터페이스 SCL (시계)과 SDA (데이터)과 모든 저속도 상태 출력물에 vcc_host에 연결된 풀업 저항기를 사용할 것입니다.
SCL과 SDA는 버스 토폴로지를 지원할 수 있는 뜨거운 플러그 인터페이스입니다. 6 : 모듈프스들은 호스트 보드에 vcc_host에 끌어 올려지고 모듈에 기초가 됩니다. 삽입되고 디어설트될 때 모듈프스들은 낮다고 주장합니다
높이 모듈이 육체적으로 있을 때 호스트 커넥터를 비우세요.
7 : IntL은 출력 핀입니다. IntL이 낮을 때, 그것은 가능한 모듈 작동 결함 또는 호스트 시스템에 중대한 지위를 보여줍니다. 호스트
2번 와이어 직렬 접속을 사용하여 일시정지을 얻는 원천을 확인합니다. IntL 핀은 개방 컬렉터 출력이고, 공급을 주관하기 위해 당겨질 것입니다
호스트 보드 위의 전압. INTL 핀은 바이트 2 비트 0 (준비되지 않은 데이터)이 있는 때인 리셋의 완료가 가치를 참조한 후에 높이 디어설트됩니다의
'0'과 플래그 필드는 읽힙니다 (SFF-8636을 보세요).
8 : 라이피모드 핀은 모듈에서 프크크에 끌어 올려질 것입니다. 핀은 하드웨어 제어입니다
높을 때 모듈을 저전력 모드에 넣는데 사용됩니다. 라이피모드 핀과 power_override, power_set의 조합을 이용하여와
high_power_class_enable 소프트웨어 제어 비트 (연설 A0h, 바이트 93 비트 0,1,2), 모듈이 캔으로 만든 많은 전력이 흩어진 호스트 콘트랄하라이스.
9 : RX(n)(p/n)는 모듈 수신기 데이터 출력입니다. RX(n)(p/n)는 100 오옴으로 종결되어야 한 ac-결합 100 오옴 차동 라인입니다
달리 호스트 ASIC(SerDes)에. 교류 결합은 모듈 안에서 있고, 호스트 보드에 요구하지 않았습니다. 28 Gb / Ｓ 더에 있는 작동을 위해
관련 규격 (예를 들면, OIF CEI v3.1은) 고속 차동 라인에 대하여 신호 요구사항을 규정합니다. 더 낮은 세율로 수술을 위해 더를 언급하세요
관련 규격.
기록 : 유산 QSFP의 삽입과 호스트로의 QSFP+ 모듈의 가능성 때문에
더 높은 속도 조작을 위해 설계되어 호스트 입력의 손상 문턱치가 적어도 1600의 mV 피크 투 피크 차이이라는 것이라고 권고됩니다.
광학적 입력 신호의 손실을 위한 출력 스퀄치, 앞으로 Rx 스퀄치는 요구되고, 다음과 같이 작용할 것입니다. 광학 시그널 온의 경우에
어떠한 채널도 LOS를 주장하도록 요구된 수준이하로 거나 충분한 된 후, 저 채널을 위한 수신기 데이터 출력이 으깰 것입니다 또는
무력하게 됩니다. 찌부러지거나 불구가 된 출력된 상태에서 차별적 전압폭이 50 음피피 이하일 동안 임피던스 레벨은 유지됩니다.
정상 작동에서 디폴트 케이스는 활동적인 Rx 스퀄치를 가지고 있습니다. Rx 스퀄치는 일련인 2개 와이어를 통하여 Rx 스켈치 불능을 사용하여 비활성화시킬 수 있습니다
인터페이스. Rx 스켈치 불능은 옵션 기능입니다. 세부 사항을 위해 SFF-8636을 언급하세요.
10 : Tx(n)(p/n)는 모듈 송신기 데이터 입력입니다. 그들은 내부에 100 오옴 차별적 종결과 ac-결합 100 오옴 차동 라인입니다
모듈. 교류 결합은 모듈 안에서 있고, 호스트 보드에 요구하지 않았습니다. 28 Gb / Ｓ에 있는 작동을 위해 관련 규격 (예를 들면, OIF
CEIv3.1)는 고속 차동 라인에 대하여 신호 요구사항을 규정합니다. 더 낮은 세율로 수술을 위해 관련 규격을 언급하세요. 때문에
호스트로의 모듈의 삽입의 가능성은 더 낮은 속도 조작의 설계를 했습니다, 모듈 입력의 손상 문턱치가 적어도 있을 것입니다
1600 mV 피크 투 피크 차이. 입력 신호의 손실을 위한, 출력 스퀄치, 앞으로 Tx 스퀄치, 앞으로 Tx LOS는 옵션 기능입니다. 어디에
구현된 채 그것은 다음과 같이 작용할 것입니다. 차이의 경우에, 어떠한 채널 위의 피크 대 피크 전기 신호는 50 음피피보다 적게 됩니다,
그리고 나서 저 채널을 위한 송신기 광 출력은 으깨거나 무력하게 될 것이고 연합하는 트스로 기가 졌습니다. 으깨곤 곳에서, 더
송신기 OMA는 -26 데이터 베이스 관리 프로그램보다 작거나 같골 때 송신기 전력을 무력하게 했고 -30 데이터 베이스 관리 프로그램보다 작거나 같습니다. 를 위해
송신기 오프 조건이 송신기를 무력하게 한 평균 마력의 관점에서 규정되는 적용, 예를 들어 이더넷은 권고됩니다고
적용을 위해, 예를 들어 송신기 오프 조건이 송신기를 으깬 OMA의 관점에서 규정되는 인피니밴드는 권고됩니다. 에
Tx 스퀄치인 모듈 작동은 구현했습니다, 디폴트 케이스가 활동적인 Tx 스퀄치를 가지고 있습니다. Tx 스퀄치는 Tx 스퀄치를 사용하여 비활성화시킬 수 있습니다
2번 와이어 직렬 접속을 통하여 무능하게 하세요. Tx 스켈치 불능은 옵션 기능입니다. 세부 사항을 위해 SFF 8636을 언급하세요.
一.OEM과 ODM
OEM / ODM 명령은 이용 가능합니다.
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